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DS878是一款高速直接數字頻率合成器(DDS)，頻率調諧分辨率為32位，ROM相位分辨率為13位，DAC幅度分辨率為11位。DAC模擬輸出可在正常保持模式（用于第一奈奎斯特頻段）和回零模式（用于第一，第二和第三奈奎斯特頻段）操作之間選擇。DS878和DAC正常保持模式下，可在第一奈奎斯特頻段附近產生最高1.8 GHz的頻率（時鐘速率為3.6 GHz），或在DAC調零模式下產生最高5.4 GHz的第三奈奎斯特頻段。

DS878初始相位可以復位到零度啟動。該芯片有一對互補的模擬輸出，后端為50-∧。輸出波形的頻率可由32個頻率控制位VI[0:31]控制。DS878可接受差分時鐘輸入或單端時鐘輸入，具有50-∧片內后端端子和用戶自定義閾值。頻率分辨率位接受LVTTL或CMOS輸入電平。差分同步輸入SYNCI_P/N為多個芯片應用提供同步，啟動每個芯片準備接受頻率字輸入。

DS878內部產生的同步選通輸入除以8時鐘躍遷沿鎖存器，這些時鐘也發送到SYNCO_P/N。輸出引腳SYNCO_P/N作為參考，頻率字和頻閃輸入時序與內部同步，以8個時鐘分頻，從而正確鎖定。復位是異步的，以最大限度地降低模擬輸出有效性的時鐘延遲。

DS878主要特征

32位頻率調諧字

13位ROM相位ip地址解讀

影(ying)視中(zhong)的11位dac

鬧(nao)鐘頻繁達4.5GHz

模仿輸(shu)送(song)也可以在正常的實現(xian)制式和零制式中確定(ding)考慮

余弦波(bo)出現的某個(ge)奈奎(kui)斯(si)特帶(dai)多達2.25GHz，3、個(ge)奈奎(kui)斯(si)特光波(bo)占據常規保持(chi)良好(hao)模(mo)式切換或(huo)6.75GHz零化形式。

在4 GHz鬧鐘波特(te)率(lv)下，最次的(de)聯(lian)通寬帶SFDR相近50 dBc(dc到2 ghz下行帶寬)

50后臺開(kai)發專一性養成(cheng)弧形(xing)所在(zai)

多片(pian)關聯(lian)P/N關聯(lian)

SyncO_P/N為數(shu)據(ju)顯(xian)示訪(fang)問和同(tong)歩選數(shu)據(ju)通信號給予了(le)關聯性。

LVTTL/CMOS加(jia)數機(ji)制操控鍵盤輸入

異步歸(gui)位(RST)引(yin)腳(jiao)鼓勵0的時(shi)候(hou)(IQSL=低)或(huo)90(IQSL=高)重啟(qi)情況(kuang)下

適用于最新幀(zhen)率Word和DAC輸(shu)入輸(shu)出概率的(de)Strobe填寫(STRBUP/N)

寬的動(dong)態(tai)數(shu)據彈出任務欄(lan)圖標可以DS 878由數(shu)據存儲器和(he)微(wei)操(cao)控器操(cao)控，FPGA或DSP處理器在秒表(biao)頻(pin)繁準換歷程中(zhong)不(bu)須(xu)脫(tuo)鏈或設備故障(zhang)就(jiu)可自(zi)動(dong)更(geng)新至多8個秒表(biao)定期的頻(pin)繁字。

單(dan)-5V電源開關的能耗為4.3W

64針QFN9x9裝封

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